CN101911031B - 用于快速平台休眠和恢复的系统和方法 - Google Patents

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Abstract

在一些实施例中，一种装置包括处理器核心、较小的非易失性存储器、用于保存由处理器核心使用的操作系统、程序和数据的较大的非易失性存储器。所述装置还包括：易失性存储器，其用作处理器核心的系统存储器；以及用于控制电源管理的至少一些方面的电源管理逻辑。响应于功率状态改变命令，系统上下文被存储在较小的非易失性存储器中，随后易失性存储器断电，并且响应于恢复命令，易失性存储器被供电并且从较小的非易失性存储器接收系统上下文的至少一部分。还描述了其它实施例。

Description

用于快速平台休眠和恢复的系统和方法
技术领域
本发明的实施例总体上涉及计算机平台休眠和恢复。
背景技术
计算机系统通常具有某些低功率状态，它们被称为包括S3和S4在内的S状态。S3有时被称为待机(Standby)、睡眠(Sleep)或挂起到RAM(Suspend to RAM)。状态S3是一种睡眠状态，在该状态中，操作系统(OS)将其上下文(context)保存到物理存储器(动态随机存取存储器(DRAM))中，并且将系统置入挂起状态。在挂起状态期间，在进入S3时使用的打开的文档和程序(应用)、或至少一部分所述程序也保存在DRAM中。一些芯片组寄存器的内容也可以被写入DRAM。物理存储器DRAM有时被称为主存储器或系统存储器。在该挂起状态期间，除了DRAM和用于稍后唤醒系统的少量电路之外，从平台硬件移除所有电力。由于S3功率状态能够将OS上下文和先前使用的程序和文档保存到高速DRAM存储器中并且能够从高速DRAM存储器中恢复它们，所以S3功率状态提供了相对快速的挂起和恢复(唤醒)时间。
S4有时被称为休眠(Hibernate)、安全睡眠(Safe Sleep)或挂起到磁盘(Suspend to disk)。在S4中，OS上下文和打开的文档以及程序(或其一部分)被保存在硬盘驱动器(HDD)上而不是保存在快速DRAM存储器中。因为不对DRAM保持供电，所以允许比S3状态有更高的功率节省。但是，由于对HDD的缓慢的读取和写入访问时间，所以会有更高的时延。通常S4休眠和恢复时间在10秒的数量级。
虽然一般而言10秒可能似乎不算太长的时间，但是对于等待其计算机休眠或从休眠中恢复的用户来说，这时间似乎很长。此外，虽然在短时间内保持DRAM操作所需的电量不是很大，但是长时间的话，会对电池的电量有显著的影响。
因此，需要一种电路和技术，其提供比S4功率状态更快的休眠和恢复时间，并且消耗比S3功率状态更少的功率。
发明内容
本申请的一个方面涉及一种用于提供计算机平台休眠和恢复的装置，包括：
处理器核心；
易失性存储器，其用作所述处理器核心的系统存储器；
较小的非易失性存储器，其用于保存从所述易失性存储器复制的系统上下文信息；
较大的非易失性存储器，其用于保存由所述处理器核心使用的操作系统、程序和数据；
电源管理逻辑，其用于控制电源管理的至少一些方面；以及
嵌入式处理器，其用于控制系统上下文数据在所述易失性存储器和所述较小的非易失性存储器之间的转移，所述嵌入式处理器独立于所述处理器核心以及所述装置的平台状态；
其中，响应于挂起到易失性存储器功率状态改变命令，所述装置使得系统上下文被所述操作系统保存到所述易失性存储器的连续区域并提供设置以指示休眠状态，其中，所述设置引起中断，所述中断导致所述嵌入式处理器关闭所述处理器核心并将所述系统上下文从所述易失性存储器复制到所述较小的非易失性存储器中，随后所述嵌入式处理器将所述易失性存储器断电，并且将所述嵌入式处理器置于断电状态，并且
其中，响应于恢复命令，所述嵌入式处理器和所述处理器核心被唤醒，所述嵌入式处理器初始化所述易失性存储器，并且从所述较小的非易失性存储器向所述易失性存储器复制所述系统上下文中的至少一部分。
本申请的另一个方面涉及一种用于提供计算机平台休眠和恢复的方法，包括：
接收针对装置的挂起到易失性存储器功率状态改变命令，所述装置包括处理器核心、嵌入式处理器、易失性存储器、较小的非易失性存储器和较大的非易失性存储器，其中，所述易失性存储器用作所述处理器核心的系统存储器，所述较小的非易失性存储器用于保存从所述易失性存储器复制的系统上下文信息，所述较大的非易失性存储器用于保存由处理器核心使用的操作系统、程序和数据；
进行操作以使得所述操作系统认为是挂起到易失性存储器操作，所述操作包括：
使得系统上下文被所述操作系统保存到所述易失性存储器的连续区域，以及
提供设置以指示休眠状态，其中，所述设置引起中断，所述中断导致所述嵌入式处理器关闭所述处理器核心并将所述系统上下文从所述易失性存储器复制到所述较小的非易失性存储器中，随后所述嵌入式处理器将所述易失性存储器断电，并且将所述嵌入式处理器置于断电状态，以及
所述方法还包括：响应于恢复命令，所述嵌入式处理器和所述处理器核心被唤醒，并且所述嵌入式处理器初始化所述易失性存储器，并且从所述较小的非易失性存储器向所述易失性存储器复制所述系统上下文中的至少一部分。
附图说明
根据以下给出的详细的描述以及本发明的实施例的附图，将更充分地理解本发明，但是这些描述和附图不应用于将本发明限制到所描述的具体实施例，而仅仅是为了说明和理解。
图1是根据一些实施例的计算机系统的框图表示。
图2是根据一些实施例的移动计算机的横截面图。
图3说明了根据一些实施例的快速休眠路径和从快速休眠状态恢复的流程图。
图4-7中的每一个是根据一些实施例的计算机系统的框图表示。
具体实施方式
本发明的一些实施例涉及用于允许新的快速休眠过程的电路和技术，在所述快速休眠过程中，系统上下文被写入非易失性存储器(较小的非易失性存储器或NVRAM)，其容量比用于存储操作系统、程序和数据中的至少一个的另一个非易失性存储器(较大的非易失性存储器或硬盘驱动器)的容量小。在从快速休眠中恢复时，从较小的非易失性存储器中读取系统上下文并且系统上下文用于恢复计算机系统的操作。在一些实施例中，将系统上下文全部从DRAM系统存储器传输到较小的非易失性存储器，并且在恢复时，将其全部从较小的非易失性存储器传输到DRAM系统存储器。在其它实施例中，系统上下文可以部分地来自于例如芯片组寄存器这样的其它存储器，并且可以被直接地写回这些寄存器而不是间接地通过DRAM进行。
在一些实施例中，在快速休眠过程中，甚至在处理器核心和诸如硬盘驱动器和显示屏这样的其它系统部件被断电之后，也能发生从DRAM系统存储器到较小的非易失性存储器的传输。这允许计算机的用户感觉计算机系统是被快速关闭的，即使系统上下文的传输还未完成。因此，实施例改进了系统响应的用户感觉。这提供了更大的用户满意度。这与现有技术的S4转变形成对比，在现有技术的S4转变中，处理器在主机系统或分区进入休眠状态并且关闭之前，将所有上下文复制到硬盘驱动器(HDD)。
在一些实施例中，快速休眠过程可以发生在为S3和S4状态而设计的、并不是专门为快速休眠过程而设计的操作系统(OS)中。这可以通过使BIOS和/或另一个装置通过进行以下操作来响应挂起到RAM(S3)命令而发生：将处理器置入系统管理模式(SMM)并且控制从DRAM系统存储器到较小的非易失性存储器的传输，然后将睡眠类型改变到休眠状态。在这些实施例中，过程可以对一些OS是“透明的”。
参照图1，系统12包括处理器14，其耦合到平台控制器中心(PCH)16和系统存储器(DRAM)20。处理器14包括中央处理器单元(CPU)核心22和非核心26。术语非核心并不旨在具有受限的定义，而是一个概括性的术语，用于指处理器中的、包括不是核心部分的各种接口和控制电路的部分。非核心26包括用于控制系统存储器20的集成存储器控制器28。系统存储器20包括用于保存用于系统管理模式(SMM)的指令的部分30。SMM可以根据现有技术中的SMM技术或者是新的SMM技术或类似类型的模式。非易失性存储器(NVRAM)38通过控制器34耦合到PCH 16。在一些实施例中，NVRAM 38包括快速闪存并且控制器34是NAND控制器。在一些实施例中，控制器34可以是嵌入式处理器，如下文所述。硬盘驱动器42耦合到PCH 16，并且为处理器14保存操作系统、程序和数据。在一些实施例中，可以由系统的其它部件来使用硬盘驱动器42中的一些内容。NVRAM 38具有比硬盘驱动器42小得多的存储容量，但是具有比硬盘驱动器42更快的访问速度。因此，NVRAM 38可以被称为较小的非易失性存储器，并且硬盘驱动器42可以被称为较大的非易失性存储器。基本输入/输出系统(BIOS)48提供了系统BIOS指令。在休眠期间可以对唤醒电路50进行供电以允许恢复。在一些实施例中，图1的系统的部件被容纳在机箱52中，例如容纳在移动计算机中。
图2说明了具有基座部分64和包括显示屏68的机盖66的移动计算机62。基座部分64包括诸如图1的系统。基座部分64包括开关70以检测机盖何时被打开和关闭。基座部分64还包括按钮72(例如，键盘或诸如电源按钮这样的其它按钮)和光标控制设备94。取决于实施例和实施例的结构，可以用不同的方式来发起功率状态改变命令(例如，“待机”命令，其还被称为挂起到RAM或S3命令；或在其它实施例中为快速休眠命令)。可以发起功率状态改变命令的方式的例子包括以下各项中的一个或多个：关闭机盖、按下电源按钮、按下另一个按钮、对下拉菜单或图标发出光标控制点击或者其它方式。也可以以各种方式发起唤醒事件(恢复命令)以使得系统从休眠中恢复，这取决于实施例和实施例的结构。可以发起恢复命令的方式的例子包括以下各项中的一个或多个：打开机盖、按下电源按钮、按下另一个按钮、发出光标控制点击或其它方式。在实践中，存在较少的恢复方式，因为期望系统基本上完全断电。在一些实施例中，发起恢复命令的唯一方式是通过按下电源按钮。
参照图2，电源管理单元44包括高级配置和电源接口(ACPI)块寄存器，尽管在其它实施例中不使用ACPI寄存器。已经公布了多种ACPI规范，包括可从www.acpi.info下载的版本3.0b(2006年10月10日)。在DRAM中还保存了软件ACPI表。如现有技术中公知的，当计算机系统被打开时，系统BIOS开始执行。系统BIOS可以是平台和芯片组专用固件，并且通过ACPI表(在DRAM中)传递平台和芯片组专用信息。
ACPI寄存器包括寄存器调用睡眠类型(SLP_TYPE)寄存器和睡眠使能(SLP_EN)寄存器。假定睡眠类型寄存器中的01指示挂起并且睡眠类型寄存器中的02指示休眠。当用户选择挂起时，OS查找ACPI表并且看到挂起意味着比特01被写入睡眠类型寄存器。OS将该值编写入睡眠类型寄存器中。当OS准备好进入挂起时，它设置睡眠使能比特。在OS设置了睡眠使能比特之后，硬件进行接管并且PCH 16将平台断电，如下文所述。
可以配置系统，以使得当用户选择挂起到RAM(S3)时，系统实际上执行快速休眠。或者，快速休眠可以是用户的明确选项。下文描述了多个技术，通过这些技术可以选择挂起到RAM(S3)并且稍后恢复，但是执行快速休眠并且稍后从快速休眠恢复。
嵌入式处理器(EP)，例如嵌入式处理器34，可以是芯片组中现有的管理引擎(ME)或平台中的任何其它处理引擎(包括主机CPU的高特权模式)，其可以访问物理DRAM和一些非易失性存储器，例如闪存。EP 34可以运行来自闪存或物理存储器的它的代码，并且它的执行独立于处理器核心或主机平台状态。这允许EP 34在主机核心没有执行时，为平台执行带外管理功能。在计算机系统的芯片中只具有嵌入式处理器并不是新出现的，但是相信如本文所描述的方式一样使用嵌入式处理器是新颖的。
NVRAM 38可以在没有任何外部电源的情况下维持其上下文。闪存技术是该类存储器的例子，并且几乎在所有平台中用于存储平台的自举代码(boot strap code)(BIOS)和配置数据。该存储器的大小可以取决于平台引导自举代码的大小和当平台没有被供电时所需存储的任何其它信息。EP 34还可以使用NVRAM来存储其代码和数据。NVRAM 38可以包括闪速存储器，例如根据当前可用的技术的“快速闪存”或根据未来可用技术的“快速闪存”。除了系统上下文之外，NVRAM 38还可以用于存储其它数据。在其它所有条件相同的情况下，优选具有更快访问时间的NVRAM。在一些实施例中，NVRAM 38具有至少与DRAM系统存储器20一样大的容量，并且在一些实施例中，具有远大于DRAM系统存储器20的容量。
图3示出了快速休眠路径流程图和从快速休眠恢复的流程图的例子的概览。在不同的实施例中，细节可以不同。在图2的例子中，块80表示主机OS。休眠数据被写入系统存储器DRAM 20(其中一些在快速休眠命令之前被写入，其中一些在快速休眠命令之后被写入)。在快速休眠命令之前(其可以与S3命令相同)，平台(主机)处于S0状态并且管理引擎(ME)(其可以是嵌入式处理器34或者包括嵌入式处理器34)处于M0状态。睡眠类型寄存器被设置为S4快速，在一些系统中对于S3可以相同。当睡眠使能寄存器被设置为1时，生成硬件中断，其使得嵌入式处理器34将休眠数据从系统存储器DRAM 20复制到快速闪存NVRAM 38。然后，平台主机状态是S4并且ME具有状态M1。
一旦复制完成，ME具有M-off状态并且唤醒逻辑84开启。唤醒逻辑84可以是唤醒电路50或者可以包括唤醒电路50。可以有各种类型的唤醒逻辑。唤醒电路50可以包括物理电源按钮、特定按钮、光标控制设备、通用串行总线(USB)设备、机盖打开检测器中的一个或多个，或其它设备。
一旦所有的OS休眠相关上下文已被复制到快速NVRAM设备，那么EP将系统DRAM置入断电状态并且关闭自身。在这一时刻，仅唤醒系统所需的最少电路维持供电并且系统完全进入休眠状态。
在恢复路径的例子中，当激活唤醒逻辑84时，嵌入式处理器34将休眠数据从快速闪存NVRAM 38复制到系统存储器DRAM 20。然后，BIOS跳到OS唤醒矢量。
在一些实施例中，响应于功率状态改变命令，OS写入睡眠类型寄存器和睡眠使能寄存器。在BIOS中有单独的策略。BIOS可以具有一设置选项，在该选项用户选择起动快速休眠过程的将是S3命令——所以，当OS想要挂起到RAM时，平台进入到快速休眠。在一些实施例中，OS不了解快速休眠正在发生，而是认为发生S3改变。在一些实施例中，BIOS按照如下方式促使快速休眠。设置触发器，以使得当OS写入睡眠使能比特时，将控制传输到BIOS。(在一些实施例中，PCH 16支持硬件SMM触发器。)响应于SMM管脚被激活，系统管理模式(SMM)从OS接管控制。SMM可以是现有技术的SMM或修改的新SMM。在一些实施例中，处理器14包括SMM管脚——当使其有效时，使得处理器核心进入到SMM模式。处理器核心中断并且跳转到DRAM 20的SMRAM部分30。SMRAM部分30归BIOS所有，其可以在导入时安装内容。当使SMM有效时，CPU从SMRAM30取得其指令。在SMM指令的末端，可以有用于返回到OS的恢复命令。
在一些实施例中，在将DRAM 20的内容传输到NVRAM 38之后，将睡眠类型寄存器从挂起到RAM S3改变为休眠到DISC S4(例如，01到02)。在睡眠类型寄存器改变之后，OS如同系统处于S3那样继续运行，并且BIOS如同系统处于休眠模式那样继续运行，这使得如以上讨论的那样，系统被关闭，只有一小部分例外。从这个意义上说，在一些实施例中，当实际上系统处于快速休眠状态时，OS被“欺骗”以为系统处于S3。这迫使硬件平台转变到更深度的睡眠状态S4，但是它不迫使OS向硬盘驱动器进行复制，这是因为OS认为平台处于挂起状态。因此，关闭过程比在现有技术S4的情况下更快。当上下文的转移发生在系统的其余部分中的大部分正在关闭时以及在这之后时，过程甚至会更快。
下文描述针对一些实施例的进入快速休眠的一些方面，但是在其它实施例中的其它方面中，细节会有不同。
1、OS通过将其当前状态保存在DRAM的固定的连续区域中来启动快速休眠转换。该休眠数据区域包括在恢复时用于还原系统的OS唤醒矢量以及硬件和软件上下文。
2、OS设置芯片组(PCH 16)中的SLP_TYPE和SLP_EN比特以向芯片组硬件指示它想要转换入休眠状态。
3、SLP_EN比特的设置引起到EP 34的硬件中断。EP 34评估中断并且确定系统想要进入休眠睡眠状态。EP 34通过以下操作来启动平台的部分断电：关闭处理器核心22以及所有用户可见的平台硬件；只留下DRAM 20被供电。注意，可以替代地在一些延迟(例如，15分钟)之后来触发这一操作，从而允许系统针对短持续时间的睡眠间隔使用传统的S3，并且仅在延长的S3间隔(例如，15分钟)之后，触发休眠功能。
4、EP 34经由其内部的SRAM缓冲器82(如图2所示)将OS休眠数据区域从系统DRAM 20复制到快速NVRAM存储器38中。
5、EP 34提供唤醒逻辑84以允许从睡眠状态唤醒。
6、EP 34关闭DRAM 20并且将其自身置入断电状态。
7、在这一时刻，除了唤醒系统所需的最少硬件之外，整个系统被断电。
当发生唤醒事件(启动恢复命令)时，EP 34首先供电，并且立即初始化DRAM系统存储器20，并且开始从快速NVRAM设备38中还原OSDRAM上下文。在一些实施例中，甚至在处理器开始执行系统BIOS代码之前，就会发生DRAM的还原。当BIOS按照其常规休眠恢复路径操作时，EP 34继续在DRAM 20中还原OS上下文，并且在BIOS 48完成处理器、芯片组和其它平台部件的初始化时，EP 34已经完成在DRAM中还原所有OS休眠恢复上下文。BIOS 48结束其执行并且将控制转交到OS休眠唤醒矢量，其原本嵌入在DRAM中的OS休眠恢复上下文中，并且已被EP连同其余的休眠数据一起还原。一旦获得控制，OS唤醒代码立即开始从DRAM 20执行并且使用DRAM中的休眠恢复数据来还原剩余的OS部件。在其它实施例中，细节会不同。
在一些实施例中，在从快速休眠中恢复时，BIOS开始执行并初始化包括DRAM 20在内的系统部件，所述DRAM 20被初始化是因为断电了。NVRAM 34也被初始化。一旦存储器被初始化，NVRAM 38中的内容中的至少一些被复制到DRAM 20。在BIOS中进行从休眠(S4)流程到挂起(S3)流程的软件切换。然后，BIOS跳转到S3_wake_vector。在这一时刻，OS具有继续进行OS S3唤醒所需的内容。
在一些实施例中，存在另外的处理代理，用于通过增加压缩硬件进一步加速恢复流程，或者通过增加加密功能来增加安全功能。
以下描述针对一些实施例的从快速休眠恢复的一些方面，但是在其它实施例中，细节会不同。
1、用户动作引起唤醒事件；使得EP 34和处理器14唤醒。
2、EP 34检测到系统正从快速休眠事件中唤醒，所以它初始化存储器，并且开始将OS休眠恢复上下文经由其内部的SRAM缓冲器82从NVRAM38复制到DRAM存储器20。
3、因此，CPU重置并且开始执行系统BIOS代码。BIOS执行其休眠恢复路径，并且最终将控制转交给现在已被EP还原的DRAM中的OS唤醒矢量。
4、在这一时刻，控制进入DRAM中的OS唤醒矢量，并且OS使用系统存储器中的休眠恢复数据来开始还原其状态。
因为对NVRAM 38的读取和写入访问时间远快于对硬盘驱动器42的读取和写入访问时间，所以本发明的实施例的挂起和恢复时间远小于现有技术的S4挂起到DISC和恢复的时间。
实施例可以通过在休眠和恢复之间关闭几乎整个系统，从而提供对挂起和恢复的更快的响应时间以及更长的电池寿命。
图4说明了类似于图1的系统，但是其中，NVRAM控制器(例如，嵌入式处理器)134位于处理器114的非核心126中，其耦合到PCH 132。BIOS 148可以与BIOS 48相同或者与BIOS 48有一些不同。
图5说明了类似于图4的系统，除了PM单元244被包括在处理器214的非核心220中而不是包括在PCH 232中以外。在PCH 232中可以有另一个PM单元。BIOS 248可以与BIOS 48相同或者与BIOS 48有一些不同。电源管理逻辑可以被包括在处理器和PCH的组合中，或者仅在一个中或另一个中。
图6说明了类似于图1的系统，但是其中有两个处理器314-1和314-2，它们分别如图所示包括非核心326-1和326-2，非核心326-1和326-2具有耦合到存储器20-1和20-2(具有部分30-1和30-2)的IMC 28-1和28-2。处理器314-1和314-2耦合到PCH 316。处理器314-1和314-2、非核心326-1和326-2、控制器334、PM单元344、BIOS 348可以与处理器14、非核心20、控制器34、PM单元44和BIOS 48相同或不同。
图7说明了类似于图1的系统，除了存储器控制器428位于控制器中心416中而不是位于处理器414的非核心416中以外。存储器控制器428、BIOS 444和电源管理单元444可以与存储器控制器28、BIOS 48和电源管理单元44相同或不同。
在图中，CPU核心22、存储器控制器28、控制器34、存储器20和部分30、NVRAM 38和硬盘驱动器42的不同实例彼此可以相同或不同。
在一些现有技术的正常S4恢复过程期间，BIOS可以在将控制转交到OS加载器之前花费10-15秒以初始化系统。在一些实施例中，在快速休眠中，只要DRAM上下文被还原(经由CPU SMM或EP)，BIOS就从S4切换到S3路径。这允许BIOS采用更快(例如，几百毫秒)的S3恢复路径并且快速地跳转到OS唤醒矢量。在其它实施例中，细节会不同。
本发明并不限于使用任何特定的操作系统。一些实施例可以用于Microsoft Windows、Vista、Mac OS。
睡眠类型寄存器和睡眠使能寄存器可以是物理上分离的寄存器或者是较大寄存器的子部分。
NVRAM 38可以都在一个物理位置或分布在不同的物理位置。
补充信息和实施例
本文提及的“逻辑”可以被实现为电路、软件、微代码或它们的组合。
图中的块的形状和相对大小并不旨在显示实际的形状和相对的大小。实际的实现可以包括没有在图中说明的另外的部件以及在这些部件之间的互连。
实施例是本发明的实现或例子。在说明书中提及的“实施例”、“一个实施例”、“一些实施例”或“其它实施例”意味着结合实施例所描述的特定特征、结构或特性被包括在至少一些实施例中，但并不必然包含在所有实施例中。各处出现的“实施例”、“一个实施例”或“一些实施例”并不必然都指相同的实施例。
当描述了部件“A”耦合到部件“B”时，部件A可能直接耦合到部件B或者例如通过部件C间接地耦合。
当说明书或权利要求书记载了部件、特征、结构、过程或特性A“引起”部件、特征、结构、过程或特性B时，它意味着“A”至少是“B”的一部分诱因，而且还可能有至少一个其它部件、特征、结构、过程或特性有助于引起“B”。同样，A响应于B不意味着它并不还响应于C。
如果说明书记载了部件、特征、结构、过程或特性“可以”、“可能”、或者“能够”被包括，则该部件、特征、结构、过程或特性并不必须被包括。如果说明书或权利要求书提及“一”、或“一个”部件，其并不意味着仅有一个部件。
本发明并不被限制于本文所描述的特定细节。实际上，在本发明的范围内，可以对上述描述和附图做出许多其它改变。因此，由以下包括任何对它们的修改的权利要求定义本发明的范围。

Claims (12)

1.一种用于提供计算机平台休眠和恢复的装置，包括：
处理器核心；
易失性存储器，其用作所述处理器核心的系统存储器；
较小的非易失性存储器，其用于保存从所述易失性存储器复制的系统上下文信息；
较大的非易失性存储器，其用于保存由所述处理器核心使用的操作系统、程序和数据；
电源管理逻辑，其用于控制电源管理的至少一些方面；以及
嵌入式处理器，其用于控制系统上下文数据在所述易失性存储器和所述较小的非易失性存储器之间的转移，所述嵌入式处理器独立于所述处理器核心以及所述装置的平台状态；
其中，响应于挂起到易失性存储器功率状态改变命令，所述装置使得系统上下文被所述操作系统保存到所述易失性存储器的连续区域并提供设置以指示休眠状态，其中，所述设置引起中断，所述中断导致所述嵌入式处理器关闭所述处理器核心并将所述系统上下文从所述易失性存储器复制到所述较小的非易失性存储器中，随后所述嵌入式处理器将所述易失性存储器断电，并且将所述嵌入式处理器置于断电状态，并且
其中，响应于恢复命令，所述嵌入式处理器和所述处理器核心被唤醒，所述嵌入式处理器初始化所述易失性存储器，并且从所述较小的非易失性存储器向所述易失性存储器复制所述系统上下文中的至少一部分。
2.根据权利要求1所述的装置，其中，所述电源管理逻辑进行操作，以使得当实际上所述系统上下文被存储在所述较小的非易失性存储器中，并且随后所述易失性存储器被所述嵌入式处理器断电时，所述操作系统认为是挂起到易失性存储器操作。
3.根据权利要求1所述的装置，其中，在所述嵌入式处理器完成将所述系统上下文从所述易失性存储器复制到所述较小的非易失性存储器之前，所述处理器核心被断电。
4.根据权利要求1所述的装置，其中，响应于所述功率状态改变命令，所述系统初始执行挂起到易失性存储器操作，其中，所述系统上下文被存储在所述易失性存储器中，然后，如果在特定量的时间内没有活动，则所述系统上下文被存储在所述较小的非易失性存储器中。
5.根据权利要求4所述的装置，其中，在完成将所述系统上下文存储在所述较小的非易失性存储器之前，所述处理器核心被断电。
6.根据权利要求1所述的装置，还包括处理器的非核心部分，并且其中，通过所述非核心，所述嵌入式处理器将所述系统上下文从所述易失性存储器复制到所述较小的非易失性存储器。
7.根据权利要求6所述的装置，其中，所述电源管理逻辑的至少一部分包括在所述非核心部分中。
8.根据权利要求1所述的装置，还包括BIOS，并且其中，所述BIOS引起所述系统上下文的从所述易失性存储器到所述较小的非易失性存储器的复制，并且在所述系统上下文的从所述易失性存储器到所述较小的非易失性存储器的所述复制之后，所述BIOS引起睡眠类型寄存器中的从挂起到易失性存储器状态到休眠状态的改变。
9.根据权利要求8所述的装置，其中，所述BIOS通过引起所述睡眠类型寄存器中的比特的改变来引起所述睡眠类型寄存器中的从挂起到易失性存储器状态到休眠状态的改变。
10.一种用于提供计算机平台休眠和恢复的方法，包括：
接收针对装置的挂起到易失性存储器功率状态改变命令，所述装置包括处理器核心、嵌入式处理器、易失性存储器、较小的非易失性存储器和较大的非易失性存储器，其中，所述易失性存储器用作所述处理器核心的系统存储器，所述较小的非易失性存储器用于保存从所述易失性存储器复制的系统上下文信息，所述较大的非易失性存储器用于保存由处理器核心使用的操作系统、程序和数据；
进行操作以使得所述操作系统认为是挂起到易失性存储器操作，所述操作包括：
使得系统上下文被所述操作系统保存到所述易失性存储器的连续区域，以及
提供设置以指示休眠状态，其中，所述设置引起中断，所述中断导致所述嵌入式处理器关闭所述处理器核心并将所述系统上下文从所述易失性存储器复制到所述较小的非易失性存储器中，随后所述嵌入式处理器将所述易失性存储器断电，并且将所述嵌入式处理器置于断电状态，以及
所述方法还包括：响应于恢复命令，所述嵌入式处理器和所述处理器核心被唤醒，并且所述嵌入式处理器初始化所述易失性存储器，并且从所述较小的非易失性存储器向所述易失性存储器复制所述系统上下文中的至少一部分。
11.根据权利要求10所述的方法，还包括：在完成将所述系统上下文从所述易失性存储器复制到所述较小的非易失性存储器中之前，对所述处理器核心断电。
12.根据权利要求10所述的方法，其中，响应于所述挂起到易失性存储器功率状态改变命令，初始执行挂起到易失性存储器操作，其中，所述系统上下文被存储在所述易失性存储器中，然后，如果在特定量的时间内没有活动，则将所述系统上下文存储在所述较小的非易失性存储器中。
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